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2 TOPPERSプロジェクト 設計メモ
3 Dual-Timer Module（SP804）に関するメモ
4
5 作成者
6: 高田広章（名古屋大学）
7 最終更新: 2015年8月9日
8
9○メモの位置づけ
10
11このメモは，ARM Dual-Timer Module（SP804）に関して，TOPPERSカーネルをポー
12ティングするにあたって必
13要となる事項
14をまとめたものである．
15
16○目次
17
18・参考文献
19・概要
20・動作モード
21・プログラミングモデル
22
23○参考文献
24
25[1] ARM Dual-Timer Module (SP804) Technical Reference Manual, 2004
26Revision: r1p0
27DDI0271.pdf
28
29○概要（[1] 第1章）
30
31・AMBAのAPBに接続されるスレーブモジュール
32・2つのプログラマブル32/16ビットダウンカウンタ
33 - フリーラン，周期，ワンショットモード
34・2つのカウンタでå…
35±é€šã®ã‚¯ãƒ­ãƒƒã‚¯ï¼Žã‚¯ãƒ­ãƒƒã‚¯ã‚¤ãƒãƒ¼ãƒ–ル信号を個別に持つ
36・0に到達すると割込みをかけることができる
37
38○動作モード（[2] 2.1節，2.2.6節）
39
40・フリーランニング
41 - 0に向けてダウンカウントし，0に到達したら最大値に戻る
42 - 制御レジスタのタイマモードを1，ワンショットを0に設定
43 ★
44注意：第3章の記述と一致しておらず，間違いと思われる
45
46・周期
47 - 0に向けてダウンカウントし，0に到達したらリロード値に戻る
48 - 制御レジスタのタイマモードを0，ワンショットを0に設定
49 ★
50注意：第3章の記述と一致しておらず，間違いと思われる
51
52・ワンショット
53 - 0に向けてダウンカウントし，0に到達したら止まる
54 - 制御レジスタのワンショットを1に設定
55
56○プログラミングモデル（Programmers' Model）（[1] 第3章）
57
58※凡例：
59 レジスタ名（レジスタ略称）オフセット，ビット幅
60
61
62タイマ1ロードレジスタ（Timer1Load，LR）0x00，32（RW）
63 - 周期モードで，カウントレジスタが0になった時に，カウンタにリロー
64 ドする値を保持するレジスタ．
65 - このレジスタに書き込むと，カウントレジスタにも書き込まれる．
66 - 最小値は1，0を書き込むと即座に割込みが発生する
67 - バックグランドロードレジスタへの書き込みによっても，上書きされる
68 + この場合，現在のカウント値は変わらない
69
70タイマ1現在値レジスタ（Timer1Value，CVR）0x04，32（RO）
71 - ダウンカウンタを保持するリードオンリーのレジスタ．
72
73タイマ1制御レジスタ（Timer1Control，CR）0x08，8ビット（RW）
74 [31:8] 予約
75 [7] タイマイネーブル
76 [6] タイマモード（0：フリーラン，1：周期）
77 [5] 割込みイネーブル
78 [4] 予約
79 [3:2] プリスケーラ（00：1分割，01：16分割，10：256分割）
80 [1] タイマサイズ（0：16ビット，1：32ビット）
81 [0] ワンショット（0：ラッピングモード，1：ワンショットモード）
82 - タイマのコンフィギュレーションを変更する時は，一度，タイマを止め
83 なければならない．
84
85タイマ1割込みクリア（Timer1IntClr，ICR）0x0c，-（WO）
86 - 書込みにより割込み要求がクリアされる
87
88タイマ1å…
89ƒå‰²è¾¼ã¿çŠ¶æ…
90‹ï¼ˆTimer1RIS，RIS）0x10，1ビット（RO）
91 [31:1] 予約
92 [0] 生の割込み状æ…
93‹
94
95タイマ1マスク割込み状æ…
96‹ï¼ˆTimer1MIS，MIS）0x14，1ビット（RO）
97 [31:1] 予約
98 [0] 許可された割込み状æ…
99‹
100 生の割込み状æ…
101‹ã¨ï¼Œå‰²è¾¼ã¿ã‚¤ãƒãƒ¼ãƒ–ルのAND
102
103タイマ1バックグラウンドロードレジスタ（Timer1BGLoad，BGLR）0x18，32ビット（RW）
104 - カウンタにリロードする値にアクセスする．
105 - ロードレジスタとの違いは，現在のカウント値がすぐには変わらないこと．
106 - 次のリロードのタイミングで有効になる．
107
108タイマ2に対しても同じレジスタがある
109
110統合テスト制御レジスタ（TimerITCR）0xf00，1ビット（RW）
111統合テスト出力セットレジスタ（TimerITOR）0xf04，2ビット（WO）
112
113●ペリフェラルの種類を識別するためのレジスタ
114
115タイマペリフェラルID0レジスタ（TimerPeriphID0）0xfe0, 8/-（RO）
116タイマペリフェラルID1レジスタ（TimerPeriphID1）0xfe4, 8/-（RO）
117タイマペリフェラルID2レジスタ（TimerPeriphID2）0xfe8, 8/-（RO）
118タイマペリフェラルID3レジスタ（TimerPeriphID3）0xfec, 8/-（RO）
119タイマ PCell ID0レジスタ（TimerPCellID0）0xff0, 8/-（RO）
120タイマ PCell ID1レジスタ（TimerPCellID1）0xff4, 8/-（RO）
121タイマ PCell ID2レジスタ（TimerPCellID2）0xff8, 8/-（RO）
122タイマ PCell ID3レジスタ（TimerPCellID3）0xffc, 8/-（RO）
123
124以上
Note: See TracBrowser for help on using the repository browser.