| [363] | 1 | /*
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| 2 | * TOPPERS/JSP Kernel
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| 3 | * Toyohashi Open Platform for Embedded Real-Time Systems/
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| 4 | * Just Standard Profile Kernel
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| 5 | *
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| 6 | * Copyright (C) 2000-2003 by Embedded and Real-Time Systems Laboratory
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| 7 | * Toyohashi Univ. of Technology, JAPAN
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| 8 | *
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| 9 | * ä¸è¨èä½æ¨©è
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| 10 | ã¯ï¼ä»¥ä¸ã® (1)ã(4) ã®æ¡ä»¶ãï¼Free Software Foundation
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| 11 | * ã«ãã£ã¦å
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| 12 | ¬è¡¨ããã¦ãã GNU General Public License ã® Version 2 ã«è¨
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| 13 | * è¿°ããã¦ããæ¡ä»¶ãæºããå ´åã«éãï¼æ¬ã½ããã¦ã§ã¢ï¼æ¬ã½ããã¦ã§ã¢
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| 14 | * ãæ¹å¤ãããã®ãå«ãï¼ä»¥ä¸åãï¼ã使ç¨ã»è¤è£½ã»æ¹å¤ã»åé
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| 15 | å¸ï¼ä»¥ä¸ï¼
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| 16 | * å©ç¨ã¨å¼ã¶ï¼ãããã¨ãç¡åã§è¨±è«¾ããï¼
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| 17 | * (1) æ¬ã½ããã¦ã§ã¢ãã½ã¼ã¹ã³ã¼ãã®å½¢ã§å©ç¨ããå ´åã«ã¯ï¼ä¸è¨ã®èä½
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| 18 | * 権表示ï¼ãã®å©ç¨æ¡ä»¶ããã³ä¸è¨ã®ç¡ä¿è¨¼è¦å®ãï¼ãã®ã¾ã¾ã®å½¢ã§ã½ã¼
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| 19 | * ã¹ã³ã¼ãä¸ã«å«ã¾ãã¦ãããã¨ï¼
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| 20 | * (2) æ¬ã½ããã¦ã§ã¢ãï¼ã©ã¤ãã©ãªå½¢å¼ãªã©ï¼ä»ã®ã½ããã¦ã§ã¢éçºã«ä½¿
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| 21 | * ç¨ã§ããå½¢ã§åé
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| 22 | å¸ããå ´åã«ã¯ï¼åé
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| 23 | å¸ã«ä¼´ãããã¥ã¡ã³ãï¼å©ç¨
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| 24 | * è
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| 26 | * ã®ç¡ä¿è¨¼è¦å®ãæ²è¼ãããã¨ï¼
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| 27 | * (3) æ¬ã½ããã¦ã§ã¢ãï¼æ©å¨ã«çµã¿è¾¼ããªã©ï¼ä»ã®ã½ããã¦ã§ã¢éçºã«ä½¿
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| 28 | * ç¨ã§ããªãå½¢ã§åé
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| 30 | * ã¨ï¼
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| 31 | * (a) åé
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| 34 | * ä½æ¨©è¡¨ç¤ºï¼ãã®å©ç¨æ¡ä»¶ããã³ä¸è¨ã®ç¡ä¿è¨¼è¦å®ãæ²è¼ãããã¨ï¼
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| 35 | * (b) åé
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| 36 | å¸ã®å½¢æ
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| 37 | ãï¼å¥ã«å®ããæ¹æ³ã«ãã£ã¦ï¼TOPPERSããã¸ã§ã¯ãã«
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| 38 | * å ±åãããã¨ï¼
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| 39 | * (4) æ¬ã½ããã¦ã§ã¢ã®å©ç¨ã«ããç´æ¥çã¾ãã¯éæ¥çã«çãããããªãæ
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| 40 | * 害ãããï¼ä¸è¨èä½æ¨©è
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| 49 | *
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| 50 | */
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| 51 |
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| 52 | #ifndef _CQ_D70F3716GC_H_
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| 53 | #define _CQ_D70F3716GC_H_
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| 54 | /*
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| 55 | * ããã»ããµã«ä¾åããå®ç¾©ï¼V850ES/JG2ç¨ï¼
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| 56 | */
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| 57 |
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| 58 | /*
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| 59 | * å
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| 60 | èµRAM
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| 61 | */
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| 62 | #define IRAM_TOP 0x03FF9000 /* å
|
|---|
| 63 | èµRAMã®å
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|---|
| 64 | é ã¢ãã¬ã¹ */
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| 65 | #define IRAM_SIZE 0x6000 /* å
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|---|
| 66 | èµRAMã®å¤§ãã 24Kbyte */
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| 67 | /*
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| 68 | * å
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| 69 | èµFlashROM
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| 70 | */
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| 71 | #define IROM_TOP 0x0000000 /* å
|
|---|
| 72 | èµFlashROMã®å
|
|---|
| 73 | é ã¢ãã¬ã¹ */
|
|---|
| 74 | #define IROM_SIZE 0x40000 /* å
|
|---|
| 75 | èµFlashROMã®å¤§ãã 256Kbyte */
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| 76 |
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| 77 |
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| 78 | /*
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| 79 | * V850ES/JG2ã®IOã¬ã¸ã¹ã¿å®ç¾©
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| 80 | */
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| 81 | #define PRCMD (0xFFFFF1FC) /* Command Register */
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|---|
| 82 | #define VSWC (0xFFFFF06E) /* System Wait Control Register */
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|---|
| 83 | #define OCDM (0xFFFFF9FC) /* OnChip Debug Mode Register */
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|---|
| 84 | #define WDTM2 (0xFFFFF6D0) /* Watchdog Debug Mode Register2 */
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| 85 |
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| 86 | /*
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|---|
| 87 | * ã¯ããã¯é¢é£
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| 88 | */
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|---|
| 89 | #define PCC (0xFFFFF828) /* Processor Clock Control Register */
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|---|
| 90 | #define PLLCTL (0xFFFFF82C) /* PLL ã³ã³ããã¼ã«ã»ã¬ã¸ã¹ã¿ */
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|---|
| 91 |
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| 92 | /*
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| 93 | * LEDé¢é£
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|---|
| 94 | */
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|---|
| 95 | /* ãã¼ãCT */
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|---|
| 96 | #define PCT (0xFFFFF00A) /* PCT Register vector */
|
|---|
| 97 | #define PMCT (0xFFFFF02A) /* PCT Mode Register vector */
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|---|
| 98 | #define PMCCT (0xFFFFF04A) /* PCT Mode Control Register vector */
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| 99 |
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| 100 | #define LED_BIT (0x40) /* LED */
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| 101 |
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| 102 | /*
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|---|
| 103 | * 16bit Interval Timer M
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| 104 | */
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|---|
| 105 | #define TM0CTL0 (0xFFFFF690)
|
|---|
| 106 | #define TM0CMP0 (0xFFFFF694)
|
|---|
| 107 |
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|---|
| 108 | /*
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|---|
| 109 | * UART0é¢é£
|
|---|
| 110 | */
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|---|
| 111 | /* ãã¼ã */
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|---|
| 112 | #define PMC3 (0xFFFFF446)
|
|---|
| 113 | #define PFC3 (0xFFFFF466)
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|---|
| 114 | #define PFCE3L (0xFFFFF706)
|
|---|
| 115 |
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|---|
| 116 | /* UART0 */
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|---|
| 117 | #define UA0CTL0 (0xFFFFFA00) /* UARTA0 å¶å¾¡ã¬ã¸ã¹ã¿0 */
|
|---|
| 118 | #define UA0OPT0 (0xFFFFFA03) /* UARTA0 ãªãã·ã§ã³å¶å¾¡ã¬ã¸ã¹ã¿0 */
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|---|
| 119 | #define UA0STR (0xFFFFFA04) /* UARTA0 ç¶æ
|
|---|
| 120 | ã¬ã¸ã¹ã¿ */
|
|---|
| 121 | #define UA0RX (0xFFFFFA06) /* UARTA0 åä¿¡ãã¼ã¿ã¬ã¸ã¹ã¿ */
|
|---|
| 122 | #define UA0TX (0xFFFFFA07) /* UARTA0 éä¿¡ãã¼ã¿ã¬ã¸ã¹ã¿ */
|
|---|
| 123 |
|
|---|
| 124 | /* ãã¼ã¬ã¼ã */
|
|---|
| 125 | #define UA0CTL1 (0xFFFFFA01) /* UARTA0 å¶å¾¡ã¬ã¸ã¹ã¿1 */
|
|---|
| 126 | #define UA0CTL2 (0xFFFFFA02) /* UARTA0 å¶å¾¡ã¬ã¸ã¹ã¿2 */
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|---|
| 127 |
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|---|
| 128 | /*
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|---|
| 129 | * IntC
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| 130 | */
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|---|
| 131 | #define TM0EQIC0 (0xFFFFF150) /* TM0EQ0 å²è¾¼ã¿å¶å¾¡ã¬ã¸ã¹ã¿ */
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|---|
| 132 | #define UA0RIC (0xFFFFF162) /* UART0 åä¿¡å®äºå²è¾¼ã¿å¶å¾¡ã¬ã¸ã¹ã¿ */
|
|---|
| 133 | #define UA0TIC (0xFFFFF164) /* UART0 é信許å¯å²è¾¼ã¿å¶å¾¡ã¬ã¸ã¹ã¿ */
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|---|
| 134 | #define IMR2 (0xFFFFF104) /* å²è¾¼ã¿ãã¹ã¯ã¬ã¸ã¹ã¿2 */
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|---|
| 135 | #define IMR2H (0xFFFFF105) /* å²è¾¼ã¿ãã¹ã¯ã¬ã¸ã¹ã¿2H */
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|---|
| 136 | #define IMR2L (0xFFFFF104) /* å²è¾¼ã¿ãã¹ã¯ã¬ã¸ã¹ã¿2L */
|
|---|
| 137 | #define ISPR (0xFFFFF1FA) /* ã¤ã³ãµã¼ãã¹ã»ãã©ã¤ãªãªãã£ã»ã¬ã¸ã¹ã¿ */
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| 138 |
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| 139 | #endif /* _CQ_D70F3716GC_H_ */
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