| 1 | /*
|
|---|
| 2 | * TOPPERS/JSP Kernel
|
|---|
| 3 | * Toyohashi Open Platform for Embedded Real-Time Systems/
|
|---|
| 4 | * Just Standard Profile Kernel
|
|---|
| 5 | *
|
|---|
| 6 | * Copyright (C) 2000-2003 by Embedded and Real-Time Systems Laboratory
|
|---|
| 7 | * Toyohashi Univ. of Technology, JAPAN
|
|---|
| 8 | * Copyright (C) 2005-2007 by Embedded and Real-Time Systems Laboratory
|
|---|
| 9 | * Graduate School of Information Science, Nagoya Univ., JAPAN
|
|---|
| 10 | *
|
|---|
| 11 | * ãLì ÒÍCFree Software Foundation ÉæÁÄö\³êÄ¢é
|
|---|
| 12 | * GNU General Public License Ì Version 2 ÉLq³êÄ¢éð©CÈ
|
|---|
| 13 | * ºÌ(1)`(4)Ìðð½·êÉÀèC{\tgEFAi{\tgEF
|
|---|
| 14 | * Aðüϵ½àÌðÜÞDȺ¯¶jðgpE¡»EüÏEÄzziȺC
|
|---|
| 15 | * pÆÄÔj·é±Æð³Åø·éD
|
|---|
| 16 | * (1) {\tgEFAð\[XR[hÌ`Åp·éêÉÍCãLÌì
|
|---|
| 17 | * \¦C±Ìpð¨æѺL̳ÛØKèªC»ÌÜÜÌ`Å\[
|
|---|
| 18 | * XR[hÉÜÜêÄ¢é±ÆD
|
|---|
| 19 | * (2) {\tgEFAðÄpÂ\ÈoCiR[hiP[^uIu
|
|---|
| 20 | * WFNgt@CâCuÈÇjÌ`Åp·éêÉÍCp
|
|---|
| 21 | * ɺ¤hL
|
|---|
| 22 | gipÒ}j
|
|---|
| 23 | AÈÇjÉCãLÌì \¦C
|
|---|
| 24 | * ±Ìpð¨æѺL̳ÛØKèðfÚ·é±ÆD
|
|---|
| 25 | * (3) {\tgEFAðÄpsÂ\ÈoCiR[hÌ`ܽÍ@íÉg
|
|---|
| 26 | * Ýñ¾`Åp·éêÉÍCÌ¢¸ê©Ìðð½·±ÆD
|
|---|
| 27 | * (a) pɺ¤hL
|
|---|
| 28 | gipÒ}j
|
|---|
| 29 | AÈÇjÉCãLÌì
|
|---|
| 30 | * \¦C±Ìpð¨æѺL̳ÛØKèðfÚ·é±ÆD
|
|---|
| 31 | * (b) pÌ`ÔðCÊÉèßéû@ÉæÁÄCãLì ÒÉñ·é
|
|---|
| 32 | * ±ÆD
|
|---|
| 33 | * (4) {\tgEFAÌpÉæè¼ÚIܽÍÔÚIɶ¶é¢©Èé¹
|
|---|
| 34 | * Q©çàCãLì ÒðÆÓ·é±ÆD
|
|---|
| 35 | *
|
|---|
| 36 | * {\tgEFAÍC³ÛØÅñ³êÄ¢éàÌÅ éDãLì ÒÍC
|
|---|
| 37 | * {\tgEFAÉÖµÄC»ÌKpÂ\«àÜßÄC¢©ÈéÛØàsí
|
|---|
| 38 | * È¢DܽC{\tgEFAÌpÉæè¼ÚIܽÍÔÚIɶ¶½¢
|
|---|
| 39 | * ©Èé¹QÉÖµÄàC»ÌÓCðíÈ¢D
|
|---|
| 40 | *
|
|---|
| 41 | */
|
|---|
| 42 | #ifndef TOPPERS_CQ_STARM_H
|
|---|
| 43 | #define TOPPERS_CQ_STARM_H
|
|---|
| 44 |
|
|---|
| 45 | #include <sil.h>
|
|---|
| 46 |
|
|---|
| 47 | /*
|
|---|
| 48 | * CORTEX-M3 CPUÌ˶ÌCN[h
|
|---|
| 49 | */
|
|---|
| 50 | #include "arm_m_iccarm/arm_m.h"
|
|---|
| 51 |
|
|---|
| 52 | /*
|
|---|
| 53 | * VXeNbNÌè`
|
|---|
| 54 | */
|
|---|
| 55 | #define BUS_CLOCK (60000000)
|
|---|
| 56 | #define SYS_CLOCK (120000000)
|
|---|
| 57 | #define FLASH_CLOCK (20000000)
|
|---|
| 58 | #define DDR_CLOCK (150000000)
|
|---|
| 59 |
|
|---|
| 60 | /*
|
|---|
| 61 | * ÝÔÌÅål
|
|---|
| 62 | */
|
|---|
| 63 | #define TMAX_INTNO (16 + 105)
|
|---|
| 64 |
|
|---|
| 65 | /*
|
|---|
| 66 | * ÝDæxÌrbg
|
|---|
| 67 | */
|
|---|
| 68 | #define TBITW_IPRI 4
|
|---|
| 69 |
|
|---|
| 70 | /*
|
|---|
| 71 | * ÝDæxrbgÌTuDæxÌrbg
|
|---|
| 72 | */
|
|---|
| 73 | #define TBITW_SUBIPRI 0
|
|---|
| 74 |
|
|---|
| 75 | /*
|
|---|
| 76 | * ÝxN^Ôè`
|
|---|
| 77 | */
|
|---|
| 78 | #define IRQ_VECTOR_USART2 (16 + 49)
|
|---|
| 79 |
|
|---|
| 80 |
|
|---|
| 81 | /* ytFWX^è` */
|
|---|
| 82 | #define PERIPH_REG_BASE (0x40000000UL)
|
|---|
| 83 | #define SRAM_BASE (0x1FFF0000UL)
|
|---|
| 84 |
|
|---|
| 85 |
|
|---|
| 86 | #define SIM_BASE (PERIPH_REG_BASE + 0x47000)
|
|---|
| 87 | #define PORTA_BASE (PERIPH_REG_BASE + 0x49000)
|
|---|
| 88 | #define PORTE_BASE (PERIPH_REG_BASE + 0x4D000)
|
|---|
| 89 | #define WDOG_BASE (PERIPH_REG_BASE + 0x52000)
|
|---|
| 90 | #define MCG_BASE (PERIPH_REG_BASE + 0x64000)
|
|---|
| 91 | #define UART2_BASE (PERIPH_REG_BASE + 0x6C000)
|
|---|
| 92 | #define PMC_BASE (PERIPH_REG_BASE + 0x7D000)
|
|---|
| 93 | #define GPIOA_BASE (PERIPH_REG_BASE + 0xFF000)
|
|---|
| 94 |
|
|---|
| 95 |
|
|---|
| 96 | /* System Control space */
|
|---|
| 97 | #define SCS_BASE (0xE000E000)
|
|---|
| 98 | #define SYSTM_BASE (SCS_BASE + 0x0010)
|
|---|
| 99 | #define NVIC_BASE (SCS_BASE + 0x0100)
|
|---|
| 100 | #define SYSCB_BASE (SCS_BASE + 0x0D00)
|
|---|
| 101 |
|
|---|
| 102 | /* WDOG */
|
|---|
| 103 | #define WDOG_STCTRTLH (WDOG_BASE + 0x00)
|
|---|
| 104 | #define WDOG_UNLOCK (WDOG_BASE + 0x0E)
|
|---|
| 105 |
|
|---|
| 106 | /* SIM */
|
|---|
| 107 | #define SIM_SCGC4 (SIM_BASE + 0x1034)
|
|---|
| 108 | #define SIM_SCGC5 (SIM_BASE + 0x1038)
|
|---|
| 109 | #define SIM_CLKDIV1 (SIM_BASE + 0x1044)
|
|---|
| 110 |
|
|---|
| 111 | /* PMC */
|
|---|
| 112 | #define PMC_REGSC (PMC_BASE + 0x02)
|
|---|
| 113 |
|
|---|
| 114 | /* PORT_A */
|
|---|
| 115 | #define PORTA_PCR10 (PORTA_BASE + 0x28)
|
|---|
| 116 | #define PORTA_PCR11 (PORTA_BASE + 0x2C)
|
|---|
| 117 | #define PORTA_PCR28 (PORTA_BASE + 0x70)
|
|---|
| 118 | #define PORTA_PCR29 (PORTA_BASE + 0x74)
|
|---|
| 119 |
|
|---|
| 120 | /* PORT_E */
|
|---|
| 121 | #define PORTE_PCR16 (PORTE_BASE + 0x40)
|
|---|
| 122 | #define PORTE_PCR17 (PORTE_BASE + 0x44)
|
|---|
| 123 |
|
|---|
| 124 | /* GPIO_A */
|
|---|
| 125 | #define GPIOA_PSOR (GPIOA_BASE + 0x04)
|
|---|
| 126 | #define GPIOA_PCOR (GPIOA_BASE + 0x08)
|
|---|
| 127 | #define GPIOA_PTOR (GPIOA_BASE + 0x0C)
|
|---|
| 128 | #define GPIOA_PDDR (GPIOA_BASE + 0x14)
|
|---|
| 129 |
|
|---|
| 130 | /* MCG */
|
|---|
| 131 | #define MCG_C1 (MCG_BASE + 0x00)
|
|---|
| 132 | #define MCG_C2 (MCG_BASE + 0x01)
|
|---|
| 133 | #define MCG_C5 (MCG_BASE + 0x04)
|
|---|
| 134 | #define MCG_C6 (MCG_BASE + 0x05)
|
|---|
| 135 | #define MCG_S (MCG_BASE + 0x06)
|
|---|
| 136 | #define MCG_C11 (MCG_BASE + 0x10)
|
|---|
| 137 | #define MCG_C12 (MCG_BASE + 0x11)
|
|---|
| 138 | #define MCG_S2 (MCG_BASE + 0x12)
|
|---|
| 139 |
|
|---|
| 140 | /* UART2 */
|
|---|
| 141 | #define UART2_BDH (UART2_BASE + 0x00)
|
|---|
| 142 | #define UART2_BDL (UART2_BASE + 0x01)
|
|---|
| 143 | #define UART2_C1 (UART2_BASE +0x02)
|
|---|
| 144 | #define UART2_C2 (UART2_BASE + 0x03)
|
|---|
| 145 | #define UART2_S1 (UART2_BASE + 0x04)
|
|---|
| 146 | #define UART2_D (UART2_BASE + 0x07)
|
|---|
| 147 | #define UART2_C4 (UART2_BASE + 0x0A)
|
|---|
| 148 |
|
|---|
| 149 | /* SCB */
|
|---|
| 150 | #define SCB_VTOR (SYSCB_BASE + 0x08)
|
|---|
| 151 | #define SCB_AIRCR (SYSCB_BASE + 0x0C)
|
|---|
| 152 | #define SCB_SHPR3 (SYSCB_BASE + 0x20)
|
|---|
| 153 |
|
|---|
| 154 | /* NVIC */
|
|---|
| 155 | #define NVIC_ENAVLE_REG(ch) (NVIC_BASE + ((ch) >> 5))
|
|---|
| 156 | #define NVIC_DISABLE_REG(ch) (NVIC_BASE + 0x80 + ((ch) >> 5))
|
|---|
| 157 | #define NVIC_SET_PEND_REG(ch) (NVIC_BASE + 0x100 + ((ch) >> 5))
|
|---|
| 158 | #define NVIC_CLEAR_PEND_REG(ch) (NVIC_BASE + 0x180 + ((ch) >> 5))
|
|---|
| 159 | #define NVIC_ACTIVE_REG(ch) (NVIC_BASE + 0x200 + ((ch) >> 5))
|
|---|
| 160 | #define NVIC_PRIO_REG(ch) (NVIC_BASE + 0x300 + ((ch) >> 2))
|
|---|
| 161 | #define NVIC_STIR (NVIC_BASE+0xE00)
|
|---|
| 162 |
|
|---|
| 163 |
|
|---|
| 164 | #ifndef TOPPERS_MACRO_ONLY
|
|---|
| 165 |
|
|---|
| 166 | #endif /* TOPPERS_MACRO_ONLY */
|
|---|
| 167 | #endif /* TOPPERS_CQ_STARM_H */
|
|---|
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