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1/*
2 * TOPPERS/ASP Kernel
3 * Toyohashi Open Platform for Embedded Real-Time Systems/
4 * Advanced Standard Profile Kernel
5 *
6 * Copyright (C) 2008-2011 by Embedded and Real-Time Systems Laboratory
7 * Graduate School of Information Science, Nagoya Univ., JAPAN
8 *
9 * ã‹L’˜ìŒ ŽÒ‚́CˆÈ‰º‚Ì(1)`(4)‚ÌðŒ‚ð–ž‚½‚·ê‡‚ÉŒÀ‚èC–{ƒ\ƒtƒgƒEƒF
10 * ƒAi–{ƒ\ƒtƒgƒEƒFƒA‚ð‰ü•Ï‚µ‚½‚à‚Ì‚ðŠÜ‚ށDˆÈ‰º“¯‚¶j‚ðŽg—pE•¡»E‰ü
11 * •ÏEÄ”z•ziˆÈ‰ºC—˜—p‚ƌĂԁj‚·‚邱‚Ƃ𖳏ž‚Å‹–‘ø‚·‚éD
12 * (1) –{ƒ\ƒtƒgƒEƒFƒA‚ðƒ\[ƒXƒR[ƒh‚ÌŒ`‚Å—˜—p‚·‚éê‡‚ɂ́Cã‹L‚Ì’˜ì
13 * Œ •\Ž¦C‚±‚Ì—˜—pðŒ‚¨‚æ‚щº‹L‚Ì–³•ÛØ‹K’肪C‚»‚Ì‚Ü‚Ü‚ÌŒ`‚Ń\[
14 * ƒXƒR[ƒh’†‚ÉŠÜ‚Ü‚ê‚Ä‚¢‚邱‚ƁD
15 * (2) –{ƒ\ƒtƒgƒEƒFƒA‚ðCƒ‰ƒCƒuƒ‰ƒŠŒ`Ž®‚ȂǁC‘¼‚̃\ƒtƒgƒEƒFƒAŠJ”­‚ÉŽg
16 * —p‚Å‚«‚éŒ`‚ōĔz•z‚·‚éê‡‚ɂ́CÄ”z•z‚É”º‚¤ƒhƒLƒ…
17ƒƒ“ƒgi—˜—p
18 * ŽÒƒ}ƒjƒ…
19ƒAƒ‹‚Ȃǁj‚ɁCã‹L‚Ì’˜ìŒ •\Ž¦C‚±‚Ì—˜—pðŒ‚¨‚æ‚щº‹L
20 * ‚Ì–³•ÛØ‹K’è‚ðŒfÚ‚·‚邱‚ƁD
21 * (3) –{ƒ\ƒtƒgƒEƒFƒA‚ðC‹@Ší‚É‘g‚ݍž‚ނȂǁC‘¼‚̃\ƒtƒgƒEƒFƒAŠJ”­‚ÉŽg
22 * —p‚Å‚«‚È‚¢Œ`‚ōĔz•z‚·‚éê‡‚ɂ́CŽŸ‚Ì‚¢‚¸‚ê‚©‚ÌðŒ‚ð–ž‚½‚·‚±
23 * ‚ƁD
24 * (a) Ä”z•z‚É”º‚¤ƒhƒLƒ…
25ƒƒ“ƒgi—˜—pŽÒƒ}ƒjƒ…
26ƒAƒ‹‚Ȃǁj‚ɁCã‹L‚Ì’˜
27 * ìŒ •\Ž¦C‚±‚Ì—˜—pðŒ‚¨‚æ‚щº‹L‚Ì–³•ÛØ‹K’è‚ðŒfÚ‚·‚邱‚ƁD
28 * (b) Ä”z•z‚ÌŒ`‘Ô‚ðC•Ê‚É’è‚ß‚é•û–@‚É‚æ‚Á‚āCTOPPERSƒvƒƒWƒFƒNƒg‚É
29 * •ñ‚·‚邱‚ƁD
30 * (4) –{ƒ\ƒtƒgƒEƒFƒA‚Ì—˜—p‚É‚æ‚è’¼Ú“I‚Ü‚½‚͊ԐړI‚ɐ¶‚¶‚é‚¢‚©‚Ȃ鑹
31 * ŠQ‚©‚ç‚àCã‹L’˜ìŒ ŽÒ‚¨‚æ‚ÑTOPPERSƒvƒƒWƒFƒNƒg‚ð–Ɛӂ·‚邱‚ƁD
32 * ‚Ü‚½C–{ƒ\ƒtƒgƒEƒFƒA‚̃†[ƒU‚Ü‚½‚̓Gƒ“ƒhƒ†[ƒU‚©‚ç‚Ì‚¢‚©‚Ȃ闝
33 * —R‚ÉŠî‚­¿‹‚©‚ç‚àCã‹L’˜ìŒ ŽÒ‚¨‚æ‚ÑTOPPERSƒvƒƒWƒFƒNƒg‚ð
34 * –Ɛӂ·‚邱‚ƁD
35 *
36 * –{ƒ\ƒtƒgƒEƒFƒA‚́C–³•ÛØ‚Å’ñ‹Ÿ‚³‚ê‚Ä‚¢‚é‚à‚Ì‚Å‚ ‚éDã‹L’˜ìŒ ŽÒ‚¨
37 * ‚æ‚ÑTOPPERSƒvƒƒWƒFƒNƒg‚́C–{ƒ\ƒtƒgƒEƒFƒA‚ÉŠÖ‚µ‚āC“Á’è‚ÌŽg—p–Ú“I
38 * ‚ɑ΂·‚é“K‡«‚àŠÜ‚߂āC‚¢‚©‚È‚é•ÛØ‚às‚í‚È‚¢D‚Ü‚½C–{ƒ\ƒtƒgƒEƒF
39 * ƒA‚Ì—˜—p‚É‚æ‚è’¼Ú“I‚Ü‚½‚͊ԐړI‚ɐ¶‚¶‚½‚¢‚©‚Ȃ鑹ŠQ‚ÉŠÖ‚µ‚Ä‚àC‚»
40 * ‚̐ӔC‚𕉂í‚È‚¢D
41 *
42 */
43
44#ifndef TOPPERS_FM3_MB9BXXX_H
45#define TOPPERS_FM3_MB9BXXX_H
46
47#include <sil.h>
48
49/*
50 * ƒVƒXƒeƒ€ƒNƒƒbƒN‚Ì’è‹`i”­UŽqŽü”g”4MHzj
51 */
52#define SystemFrequency 144000000
53#define SysFreHCLK 144000000 /* HCLK = MasterClock / 1 */
54#define SysFrePCLK0 72000000 /* PCLK0 = HCLK / 2 */
55#define SysFrePCLK1 72000000 /* PCLK1 = HCLK / 2 */
56#define SysFrePCLK2 72000000 /* PCLK2 = HCLK / 2 */
57#define SysFreTPIU 0 /* TPIUCLK : Disable */
58
59#define SYS_CLOCK (SystemFrequency)
60
61/*
62 * Š„ž‚ݔԍ†‚̍őå’l
63 */
64#define TMAX_INTNO (16 + 47)
65
66/*
67 * Š„ž‚Ý—Dæ“x‚̃rƒbƒg•
68 */
69#define TBITW_IPRI 4
70
71/*
72 * Š„ž‚Ý—Dæ“xƒrƒbƒg•’†‚̃Tƒu—Dæ“x‚̃rƒbƒg•
73 */
74#define TBITW_SUBIPRI 0
75
76/*
77 * Š„ž‚݃xƒNƒ^”ԍ†’è‹`
78 */
79#define IRQ_VECTOR_CSV (16 + 0)
80#define IRQ_VECTOR_SWDT (16 + 1)
81#define IRQ_VECTOR_LVD (16 + 2)
82#define IRQ_VECTOR_WFG (16 + 3)
83#define IRQ_VECTOR_EXINT0_7 (16 + 4)
84#define IRQ_VECTOR_EXINT8_31 (16 + 5)
85#define IRQ_VECTOR_DTIM_QDU (16 + 6)
86#define IRQ_VECTOR_MFS0RX (16 + 7)
87#define IRQ_VECTOR_MFS0TX (16 + 8)
88#define IRQ_VECTOR_MFS1RX (16 + 9)
89#define IRQ_VECTOR_MFS1TX (16 + 10)
90#define IRQ_VECTOR_MFS2RX (16 + 11)
91#define IRQ_VECTOR_MFS2TX (16 + 12)
92#define IRQ_VECTOR_MFS3RX (16 + 13)
93#define IRQ_VECTOR_MFS3TX (16 + 14)
94#define IRQ_VECTOR_MFS4RX (16 + 15)
95#define IRQ_VECTOR_MFS4TX (16 + 16)
96#define IRQ_VECTOR_MFS5RX (16 + 17)
97#define IRQ_VECTOR_MFS5TX (16 + 18)
98#define IRQ_VECTOR_MFS6RX (16 + 19)
99#define IRQ_VECTOR_MFS6TX (16 + 20)
100#define IRQ_VECTOR_MFS7RX (16 + 21)
101#define IRQ_VECTOR_MFS7TX (16 + 22)
102#define IRQ_VECTOR_PPG (16 + 23)
103#define IRQ_VECTOR_OSC_PLL_WC (16 + 24)
104#define IRQ_VECTOR_ADC0 (16 + 25)
105#define IRQ_VECTOR_ADC1 (16 + 26)
106#define IRQ_VECTOR_ADC2 (16 + 27)
107#define IRQ_VECTOR_FRTIM (16 + 28)
108#define IRQ_VECTOR_INCAP (16 + 29)
109#define IRQ_VECTOR_OUTCOMP (16 + 30)
110#define IRQ_VECTOR_BTIM0_7 (16 + 31)
111#define IRQ_VECTOR_CAN0_ETH0 (16 + 32)
112#define IRQ_VECTOR_CAN1_ETH1 (16 + 33)
113#define IRQ_VECTOR_USBF (16 + 34)
114#define IRQ_VECTOR_USBF_USBH (16 + 35)
115#define IRQ_VECTOR_DMAC0 (16 + 38)
116#define IRQ_VECTOR_DMAC1 (16 + 39)
117#define IRQ_VECTOR_DMAC2 (16 + 40)
118#define IRQ_VECTOR_DMAC3 (16 + 41)
119#define IRQ_VECTOR_DMAC4 (16 + 42)
120#define IRQ_VECTOR_DMAC5 (16 + 43)
121#define IRQ_VECTOR_DMAC6 (16 + 44)
122#define IRQ_VECTOR_DMAC7 (16 + 45)
123#define IRQ_VECTOR_BTIM8_15 (16 + 46)
124
125#define FM3_PERIPH_BASE (0x40000000UL)
126#define FM3_FLASH_IF_BASE (FM3_PERIPH_BASE + 0x00000UL)
127#define FM3_CRG_BASE (FM3_PERIPH_BASE + 0x10000UL)
128#define FM3_HWWDT_BASE (FM3_PERIPH_BASE + 0x11000UL)
129#define FM3_BT_BASE (FM3_PERIPH_BASE + 0x25000UL)
130#define FM3_ADC0_BASE (FM3_PERIPH_BASE + 0x27000UL)
131#define FM3_ADC1_BASE (FM3_PERIPH_BASE + 0x27100UL)
132#define FM3_ADC2_BASE (FM3_PERIPH_BASE + 0x27200UL)
133#define FM3_CRTRIM_BASE (FM3_PERIPH_BASE + 0x2E000UL)
134#define FM3_EXTI_BASE (FM3_PERIPH_BASE + 0x30000UL)
135#define FM3_INTREQ_BASE (FM3_PERIPH_BASE + 0x31000UL)
136#define FM3_GPIO_BASE (FM3_PERIPH_BASE + 0x33000UL)
137#define FM3_MFS0_UART_BASE (FM3_PERIPH_BASE + 0x38000UL)
138#define FM3_MFS1_UART_BASE (FM3_PERIPH_BASE + 0x38100UL)
139#define FM3_MFS2_UART_BASE (FM3_PERIPH_BASE + 0x38200UL)
140#define FM3_MFS3_UART_BASE (FM3_PERIPH_BASE + 0x38300UL)
141#define FM3_MFS4_UART_BASE (FM3_PERIPH_BASE + 0x38400UL)
142#define FM3_MFS5_UART_BASE (FM3_PERIPH_BASE + 0x38500UL)
143#define FM3_MFS6_UART_BASE (FM3_PERIPH_BASE + 0x38600UL)
144#define FM3_MFS7_UART_BASE (FM3_PERIPH_BASE + 0x38700UL)
145#define FM3_EXTBUS_BASE (FM3_PERIPH_BASE + 0x3F000UL)
146#define FM3_DMAC_BASE (FM3_PERIPH_BASE + 0x60000UL)
147
148#define BITBAND(a, b) ((volatile uint32_t*)(0x42000000UL + (a - FM3_PERIPH_BASE) * 32 + b * 4))
149
150#define FM3_FLASH_IF_CRTRMM (FM3_FLASH_IF_BASE + 0x100)
151
152#define FM3_CRG_SCM_CTL (FM3_CRG_BASE + 0x00)
153#define FM3_CRG_SCM_STR (FM3_CRG_BASE + 0x04)
154#define FM3_CRG_STB_CTL (FM3_CRG_BASE + 0x08)
155#define FM3_CRG_RST_STR (FM3_CRG_BASE + 0x0c)
156#define FM3_CRG_BSC_PSR (FM3_CRG_BASE + 0x10)
157#define FM3_CRG_APBC0_PSR (FM3_CRG_BASE + 0x14)
158#define FM3_CRG_APBC1_PSR (FM3_CRG_BASE + 0x18)
159#define FM3_CRG_APBC2_PSR (FM3_CRG_BASE + 0x1C)
160#define FM3_CRG_SWC_PSR (FM3_CRG_BASE + 0x20)
161#define FM3_CRG_TTC_PSR (FM3_CRG_BASE + 0x28)
162#define FM3_CRG_CSW_TMR (FM3_CRG_BASE + 0x30)
163#define FM3_CRG_PSW_TMR (FM3_CRG_BASE + 0x34)
164#define FM3_CRG_PLL_CTL1 (FM3_CRG_BASE + 0x38)
165#define FM3_CRG_PLL_CTL2 (FM3_CRG_BASE + 0x3c)
166#define FM3_CRG_CSV_CTL (FM3_CRG_BASE + 0x40)
167#define FM3_CRG_CSV_STR (FM3_CRG_BASE + 0x44)
168#define FM3_CRG_FCSWH_CTL (FM3_CRG_BASE + 0x48)
169#define FM3_CRG_FCSWL_CTL (FM3_CRG_BASE + 0x4C)
170#define FM3_CRG_FCSWD_CTL (FM3_CRG_BASE + 0x50)
171#define FM3_CRG_DBWDT_CTL (FM3_CRG_BASE + 0x54)
172#define FM3_CRG_INT_ENR (FM3_CRG_BASE + 0x60)
173#define FM3_CRG_INT_STR (FM3_CRG_BASE + 0x64)
174#define FM3_CRG_INT_CLR (FM3_CRG_BASE + 0x68)
175
176#define SCM_CTL_MOSCE 0x02
177#define SCM_CTL_SOSCE 0x08
178#define SCM_CTL_PLLE 0x10
179#define SCM_CTL_RCS_ 0xe0
180#define SCM_STR_MORDY 0x02
181#define SCM_STR_SORDY 0x08
182#define SCM_STR_PLRDY 0x10
183#define SCM_STR_RCM 0xe0
184#define APBC1_PSR_APBC1RST 0x10
185#define APBC1_PSR_APBC1EN 0x80
186#define APBC2_PSR_APBC2RST 0x10
187#define APBC2_PSR_APBC2EN 0x80
188#define SWC_PSR_TESTB 0x80
189#define PSW_TMR_PINC 0x10
190
191#define FM3_HWWDT_WDG_LDR (FM3_HWWDT_BASE + 0x000)
192#define FM3_HWWDT_WDG_VLR (FM3_HWWDT_BASE + 0x004)
193#define FM3_HWWDT_WDG_CTL (FM3_HWWDT_BASE + 0x008)
194#define FM3_HWWDT_WDG_ICL (FM3_HWWDT_BASE + 0x00C)
195#define FM3_HWWDT_WDG_RIS (FM3_HWWDT_BASE + 0x010)
196#define FM3_HWWDT_WDG_LCK (FM3_HWWDT_BASE + 0xC00)
197
198#define FM3_BT_CH0 (FM3_BT_BASE + 0x000)
199#define FM3_BT_CH1 (FM3_BT_BASE + 0x040)
200#define FM3_BT_CH2 (FM3_BT_BASE + 0x080)
201#define FM3_BT_CH3 (FM3_BT_BASE + 0x0C0)
202#define FM3_BT_BTSEL0123 (FM3_BT_BASE + 0x101)
203#define FM3_BT_CH4 (FM3_BT_BASE + 0x200)
204#define FM3_BT_CH5 (FM3_BT_BASE + 0x240)
205#define FM3_BT_CH6 (FM3_BT_BASE + 0x280)
206#define FM3_BT_CH7 (FM3_BT_BASE + 0x2C0)
207#define FM3_BT_BTSEL4567 (FM3_BT_BASE + 0x301)
208#define FM3_BT_CH8 (FM3_BT_BASE + 0x400)
209#define FM3_BT_CH9 (FM3_BT_BASE + 0x440)
210#define FM3_BT_CHA (FM3_BT_BASE + 0x480)
211#define FM3_BT_CHB (FM3_BT_BASE + 0x4C0)
212#define FM3_BT_BTSEL89AB (FM3_BT_BASE + 0x501)
213#define FM3_BT_CHC (FM3_BT_BASE + 0x600)
214#define FM3_BT_CHD (FM3_BT_BASE + 0x640)
215#define FM3_BT_CHE (FM3_BT_BASE + 0x680)
216#define FM3_BT_CHF (FM3_BT_BASE + 0x6C0)
217#define FM3_BT_BTSELCDEF (FM3_BT_BASE + 0x701)
218#define FM3_BT_BTSSSR (FM3_BT_BASE + 0xFFC)
219
220#define FM3_BT0_PCSR (FM3_BT_CH0 + 0x00)
221#define FM3_BT0_PDUT (FM3_BT_CH0 + 0x04)
222#define FM3_BT0_TMR (FM3_BT_CH0 + 0x08)
223#define FM3_BT0_TMCR (FM3_BT_CH0 + 0x0C)
224#define FM3_BT0_STC (FM3_BT_CH0 + 0x10)
225#define FM3_BT0_TMCR2 (FM3_BT_CH0 + 0x11)
226#define FM3_BT1_PCSR (FM3_BT_CH1 + 0x00)
227#define FM3_BT1_PDUT (FM3_BT_CH1 + 0x04)
228#define FM3_BT1_TMR (FM3_BT_CH1 + 0x08)
229#define FM3_BT1_TMCR (FM3_BT_CH1 + 0x0C)
230#define FM3_BT1_STC (FM3_BT_CH1 + 0x10)
231#define FM3_BT1_TMCR2 (FM3_BT_CH1 + 0x11)
232#define FM3_BT2_PCSR (FM3_BT_CH2 + 0x00)
233#define FM3_BT2_PDUT (FM3_BT_CH2 + 0x04)
234#define FM3_BT2_TMR (FM3_BT_CH2 + 0x08)
235#define FM3_BT2_TMCR (FM3_BT_CH2 + 0x0C)
236#define FM3_BT2_STC (FM3_BT_CH2 + 0x10)
237#define FM3_BT2_TMCR2 (FM3_BT_CH2 + 0x11)
238#define FM3_BT3_PCSR (FM3_BT_CH3 + 0x00)
239#define FM3_BT3_PDUT (FM3_BT_CH3 + 0x04)
240#define FM3_BT3_TMR (FM3_BT_CH3 + 0x08)
241#define FM3_BT3_TMCR (FM3_BT_CH3 + 0x0C)
242#define FM3_BT3_STC (FM3_BT_CH3 + 0x10)
243#define FM3_BT3_TMCR2 (FM3_BT_CH3 + 0x11)
244#define FM3_BT4_PCSR (FM3_BT_CH4 + 0x00)
245#define FM3_BT4_PDUT (FM3_BT_CH4 + 0x04)
246#define FM3_BT4_TMR (FM3_BT_CH4 + 0x08)
247#define FM3_BT4_TMCR (FM3_BT_CH4 + 0x0C)
248#define FM3_BT4_STC (FM3_BT_CH4 + 0x10)
249#define FM3_BT4_TMCR2 (FM3_BT_CH4 + 0x11)
250#define FM3_BT5_PCSR (FM3_BT_CH5 + 0x00)
251#define FM3_BT5_PDUT (FM3_BT_CH5 + 0x04)
252#define FM3_BT5_TMR (FM3_BT_CH5 + 0x08)
253#define FM3_BT5_TMCR (FM3_BT_CH5 + 0x0C)
254#define FM3_BT5_STC (FM3_BT_CH5 + 0x10)
255#define FM3_BT5_TMCR2 (FM3_BT_CH5 + 0x11)
256#define FM3_BT6_PCSR (FM3_BT_CH6 + 0x00)
257#define FM3_BT6_PDUT (FM3_BT_CH6 + 0x04)
258#define FM3_BT6_TMR (FM3_BT_CH6 + 0x08)
259#define FM3_BT6_TMCR (FM3_BT_CH6 + 0x0C)
260#define FM3_BT6_STC (FM3_BT_CH6 + 0x10)
261#define FM3_BT6_TMCR2 (FM3_BT_CH6 + 0x11)
262#define FM3_BT7_PCSR (FM3_BT_CH7 + 0x00)
263#define FM3_BT7_PDUT (FM3_BT_CH7 + 0x04)
264#define FM3_BT7_TMR (FM3_BT_CH7 + 0x08)
265#define FM3_BT7_TMCR (FM3_BT_CH7 + 0x0C)
266#define FM3_BT7_STC (FM3_BT_CH7 + 0x10)
267#define FM3_BT7_TMCR2 (FM3_BT_CH7 + 0x11)
268#define FM3_BT8_PCSR (FM3_BT_CH8 + 0x00)
269#define FM3_BT8_PDUT (FM3_BT_CH8 + 0x04)
270#define FM3_BT8_TMR (FM3_BT_CH8 + 0x08)
271#define FM3_BT8_TMCR (FM3_BT_CH8 + 0x0C)
272#define FM3_BT8_STC (FM3_BT_CH8 + 0x10)
273#define FM3_BT8_TMCR2 (FM3_BT_CH8 + 0x11)
274#define FM3_BT9_PCSR (FM3_BT_CH9 + 0x00)
275#define FM3_BT9_PDUT (FM3_BT_CH9 + 0x04)
276#define FM3_BT9_TMR (FM3_BT_CH9 + 0x08)
277#define FM3_BT9_TMCR (FM3_BT_CH9 + 0x0C)
278#define FM3_BT9_STC (FM3_BT_CH9 + 0x10)
279#define FM3_BT9_TMCR2 (FM3_BT_CH9 + 0x11)
280#define FM3_BT10_PCSR (FM3_BT_CHA + 0x00)
281#define FM3_BT10_PDUT (FM3_BT_CHA + 0x04)
282#define FM3_BT10_TMR (FM3_BT_CHA + 0x08)
283#define FM3_BT10_TMCR (FM3_BT_CHA + 0x0C)
284#define FM3_BT10_STC (FM3_BT_CHA + 0x10)
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286#define FM3_BT11_PCSR (FM3_BT_CHB + 0x00)
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568
569/*
570 * FM3_MFSx Register Bit Definition
571 */
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581
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588
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609
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689
690#ifndef TOPPERS_MACRO_ONLY
691
692#endif /* TOPPERS_MACRO_ONLY */
693
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Note: See TracBrowser for help on using the repository browser.