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1/*
2 * TOPPERS/JSP Kernel
3 * Toyohashi Open Platform for Embedded Real-Time Systems/
4 * Just Standard Profile Kernel
5 *
6 * Copyright (C) 2000-2003 by Embedded and Real-Time Systems Laboratory
7 * Toyohashi Univ. of Technology, JAPAN
8 * Copyright (C) 2007-2010 by Monami Software Limited Partnership, JAPAN.
9 *
10 * 上記著作権者
11は,以下の (1)〜(4) の条件か,Free Software Foundation
12 * によってå…
13¬è¡¨ã•ã‚Œã¦ã„ã‚‹ GNU General Public License の Version 2 に記
14 * 述されている条件を満たす場合に限り,本ソフトウェア(本ソフトウェア
15 * を改変したものを含む.以下同じ)を使用・複製・改変・再é…
16å¸ƒï¼ˆä»¥ä¸‹ï¼Œ
17 * 利用と呼ぶ)することを無償で許諾する.
18 * (1) 本ソフトウェアをソースコードの形で利用する場合には,上記の著作
19 * 権表示,この利用条件および下記の無保証規定が,そのままの形でソー
20 * スコード中に含まれていること.
21 * (2) 本ソフトウェアを,ライブラリ形式など,他のソフトウェア開発に使
22 * 用できる形で再é…
23å¸ƒã™ã‚‹å ´åˆã«ã¯ï¼Œå†é…
24å¸ƒã«ä¼´ã†ãƒ‰ã‚­ãƒ¥ãƒ¡ãƒ³ãƒˆï¼ˆåˆ©ç”¨
25 * 者
26マニュアルなど)に,上記の著作権表示,この利用条件および下記
27 * の無保証規定を掲載すること.
28 * (3) 本ソフトウェアを,機器に組み込むなど,他のソフトウェア開発に使
29 * 用できない形で再é…
30å¸ƒã™ã‚‹å ´åˆã«ã¯ï¼Œæ¬¡ã®ã„ずれかの条件を満たすこ
31 * と.
32 * (a) 再é…
33å¸ƒã«ä¼´ã†ãƒ‰ã‚­ãƒ¥ãƒ¡ãƒ³ãƒˆï¼ˆåˆ©ç”¨è€…
34マニュアルなど)に,上記の著
35 * 作権表示,この利用条件および下記の無保証規定を掲載すること.
36 * (b) 再é…
37å¸ƒã®å½¢æ…
38‹ã‚’,別に定める方法によって,TOPPERSプロジェクトに
39 * 報告すること.
40 * (4) 本ソフトウェアの利用により直接的または間接的に生じるいかなる損
41 * 害からも,上記著作権者
42およびTOPPERSプロジェクトをå…
43è²¬ã™ã‚‹ã“と.
44 *
45 * 本ソフトウェアは,無保証で提供されているものである.上記著作権者
46お
47 * よびTOPPERSプロジェクトは,本ソフトウェアに関して,その適用可能性も
48 * 含めて,いかなる保証も行わない.また,本ソフトウェアの利用により直
49 * 接的または間接的に生じたいかなる損害に関しても,その責任を負わない.
50 *
51 */
52
53#ifndef _CQ_D70F3716GC_H_
54#define _CQ_D70F3716GC_H_
55/*
56 * プロセッサに依存する定義(V850ES/JG2用)
57 */
58
59/*
60 * 内
61蔵RAM
62 */
63#define IRAM_TOP 0x00140000 /* 内
64蔵RAMのå…
65ˆé ­ã‚¢ãƒ‰ãƒ¬ã‚¹ */
66#define IRAM_SIZE 0x6000 /* 内
67蔵RAMの大きさ 24Kbyte */
68/*
69 * 内
70蔵FlashROM
71 */
72#define IROM_TOP 0x0000000 /* 内
73蔵FlashROMのå…
74ˆé ­ã‚¢ãƒ‰ãƒ¬ã‚¹ */
75#define IROM_SIZE 0x40000 /* 内
76蔵FlashROMの大きさ 256Kbyte */
77
78
79/*
80 * V850ES/JG2のIOレジスタ定義
81 */
82#define PRCMD (0xFFFFF1FC) /* Command Register */
83#define VSWC (0xFFFFF06E) /* System Wait Control Register */
84#define OCDM (0xFFFFF9FC) /* OnChip Debug Mode Register */
85#define WDTM2 (0xFFFFF6D0) /* Watchdog Debug Mode Register2 */
86
87/*
88 * クロック関連
89 */
90#define PCC (0xFFFFF828) /* Processor Clock Control Register */
91#define PLLCTL (0xFFFFF82C) /* PLL コントロール・レジスタ */
92
93/*
94 * LED関連
95 */
96/* ポートCT */
97#define PCT (0xFFFFF00A) /* PCT Register vector */
98#define PMCT (0xFFFFF02A) /* PCT Mode Register vector */
99#define PMCCT (0xFFFFF04A) /* PCT Mode Control Register vector */
100
101#define LED_BIT (0x40) /* LED */
102
103/*
104 * 16bit Interval Timer M
105 */
106#define TM0CTL0 (0xFFFFF690)
107#define TM0CMP0 (0xFFFFF694)
108
109/*
110 * UART0関連
111 */
112/* ポート */
113#define PMC3 (0xFFFFF446)
114#define PFC3 (0xFFFFF466)
115#define PFCE3L (0xFFFFF706)
116
117/* UART0 */
118#define UA0CTL0 (0xFFFFFA20) /* UARTA0 制御レジスタ0 */
119#define UA0OPT0 (0xFFFFFA23) /* UARTA0 オプション制御レジスタ0 */
120#define UA0STR (0xFFFFFA24) /* UARTA0 状æ…
121‹ãƒ¬ã‚¸ã‚¹ã‚¿ */
122#define UA0RX (0xFFFFFA26) /* UARTA0 受信データレジスタ */
123#define UA0TX (0xFFFFFA27) /* UARTA0 送信データレジスタ */
124
125/* ボーレート */
126#define UA0CTL1 (0xFFFFFA21) /* UARTA0 制御レジスタ1 */
127#define UA0CTL2 (0xFFFFFA22) /* UARTA0 制御レジスタ2 */
128
129/*
130 * IntC
131 */
132#define TM0EQIC0 (0xFFFFF150) /* TM0EQ0 割込み制御レジスタ */
133#define UA0RIC (0xFFFFF16A) /* UART0 受信完了割込み制御レジスタ */
134#define UA0TIC (0xFFFFF16C) /* UART0 送信許可割込み制御レジスタ */
135#define IMR2 (0xFFFFF104) /* 割込みマスクレジスタ2 */
136#define IMR2H (0xFFFFF105) /* 割込みマスクレジスタ2H */
137#define IMR2L (0xFFFFF104) /* 割込みマスクレジスタ2L */
138#define ISPR (0xFFFFF1FA) /* インサービス・プライオリティ・レジスタ */
139
140#endif /* _CQ_D70F3716GC_H_ */
Note: See TracBrowser for help on using the repository browser.