[363] | 1 | /*
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| 2 | * TOPPERS/JSP Kernel
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| 3 | * Toyohashi Open Platform for Embedded Real-Time Systems/
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| 4 | * Just Standard Profile Kernel
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| 5 | *
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| 6 | * Copyright (C) 2000-2003 by Embedded and Real-Time Systems Laboratory
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| 7 | * Toyohashi Univ. of Technology, JAPAN
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| 8 | *
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| 9 | * ä¸è¨èä½æ¨©è
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| 10 | ã¯ï¼ä»¥ä¸ã® (1)ã(4) ã®æ¡ä»¶ãï¼Free Software Foundation
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| 11 | * ã«ãã£ã¦å
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| 12 | ¬è¡¨ããã¦ãã GNU General Public License ã® Version 2 ã«è¨
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| 13 | * è¿°ããã¦ããæ¡ä»¶ãæºããå ´åã«éãï¼æ¬ã½ããã¦ã§ã¢ï¼æ¬ã½ããã¦ã§ã¢
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| 15 | å¸ï¼ä»¥ä¸ï¼
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| 16 | * å©ç¨ã¨å¼ã¶ï¼ãããã¨ãç¡åã§è¨±è«¾ããï¼
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| 17 | * (1) æ¬ã½ããã¦ã§ã¢ãã½ã¼ã¹ã³ã¼ãã®å½¢ã§å©ç¨ããå ´åã«ã¯ï¼ä¸è¨ã®èä½
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| 18 | * 権表示ï¼ãã®å©ç¨æ¡ä»¶ããã³ä¸è¨ã®ç¡ä¿è¨¼è¦å®ãï¼ãã®ã¾ã¾ã®å½¢ã§ã½ã¼
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| 19 | * ã¹ã³ã¼ãä¸ã«å«ã¾ãã¦ãããã¨ï¼
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| 20 | * (2) æ¬ã½ããã¦ã§ã¢ãï¼ã©ã¤ãã©ãªå½¢å¼ãªã©ï¼ä»ã®ã½ããã¦ã§ã¢éçºã«ä½¿
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| 21 | * ç¨ã§ããå½¢ã§åé
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| 23 | å¸ã«ä¼´ãããã¥ã¡ã³ãï¼å©ç¨
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| 34 | * ä½æ¨©è¡¨ç¤ºï¼ãã®å©ç¨æ¡ä»¶ããã³ä¸è¨ã®ç¡ä¿è¨¼è¦å®ãæ²è¼ãããã¨ï¼
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| 35 | * (b) åé
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| 36 | å¸ã®å½¢æ
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| 37 | ãï¼å¥ã«å®ããæ¹æ³ã«ãã£ã¦ï¼TOPPERSããã¸ã§ã¯ãã«
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| 39 | * (4) æ¬ã½ããã¦ã§ã¢ã®å©ç¨ã«ããç´æ¥çã¾ãã¯éæ¥çã«çãããããªãæ
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| 49 | *
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| 50 | * @(#) $Id: dve68k_dga.h,v 1.2 2003/06/04 01:52:23 hiro Exp $
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| 52 |
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| 54 | * DGAã®ã¢ã¯ã»ã¹ã¦ã¼ãã£ãªãã£
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| 55 | */
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| 56 |
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| 57 | #ifndef _DVE68K_DGA_H_
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| 58 | #define _DVE68K_DGA_H_
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| 59 |
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| 60 | /*
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| 61 | * DGAã®å²è¾¼ã¿å¶å¾¡ãããã®å®ç¾©
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| 62 | */
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| 63 | #define TBIT_ABT 0x40000000u /* ã¢ãã¼ãå²è¾¼ã¿ããã */
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| 64 | #define TBIT_SQR 0x04000000u /* SQR å²è¾¼ã¿ããã */
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| 65 | #define TBIT_TT0 0x00100000u /* ã¿ã¤ã0 å²è¾¼ã¿ããã */
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| 66 | #define TBIT_GP0 0x00010000u /* ã·ãªã¢ã«I/O å²è¾¼ã¿ããã */
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| 67 |
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| 68 | /*
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| 69 | * DGAã®å²è¾¼ã¿ã¬ãã«è¨å®ã®ããã®å®ç¾©
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| 70 | */
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| 71 | #define TIRQ_NMI 0x7u /* ãã³ãã¹ã«ãã«å²è¾¼ã¿ */
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| 72 | #define TIRQ_LEVEL6 0x6u /* å²è¾¼ã¿ã¬ãã«6 */
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| 73 | #define TIRQ_LEVEL5 0x5u /* å²è¾¼ã¿ã¬ãã«5 */
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| 74 | #define TIRQ_LEVEL4 0x4u /* å²è¾¼ã¿ã¬ãã«4 */
|
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| 75 | #define TIRQ_LEVEL3 0x3u /* å²è¾¼ã¿ã¬ãã«3 */
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| 76 | #define TIRQ_LEVEL2 0x2u /* å²è¾¼ã¿ã¬ãã«2 */
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| 77 | #define TIRQ_LEVEL1 0x1u /* å²è¾¼ã¿ã¬ãã«1 */
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| 78 |
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| 79 | #define TBIT_ABTIL 24 /* ã¢ãã¼ãå²è¾¼ã¿ */
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| 80 | #define TBIT_SQRIL 8 /* SRQ å²è¾¼ã¿ */
|
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| 81 |
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| 82 | #define TBIT_TT0IL 16 /* ã¿ã¤ã0 å²è¾¼ã¿ */
|
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| 83 | #define TBIT_GP0IL 0 /* ã·ãªã¢ã«I/O å²è¾¼ã¿ */
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| 84 |
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| 85 | #ifndef _MACRO_ONLY
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| 86 |
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| 87 | /*
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| 88 | * DGAã®ã¬ã¸ã¹ã¿ã¸ã®ã¢ã¯ã»ã¹é¢æ°
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| 89 | */
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| 90 |
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| 91 | Inline UW
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| 92 | dga_read(VP addr)
|
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| 93 | {
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| 94 | return((UW) dga_rew_reg(addr));
|
---|
| 95 | }
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| 96 |
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| 97 | Inline void
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| 98 | dga_write(VP addr, UW val)
|
---|
| 99 | {
|
---|
| 100 | dga_wrw_reg(addr, (VW) val);
|
---|
| 101 | }
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| 102 |
|
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| 103 | Inline void
|
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| 104 | dga_bit_or(VP addr, UW bitpat)
|
---|
| 105 | {
|
---|
| 106 | dga_write(addr, dga_read(addr) | bitpat);
|
---|
| 107 | }
|
---|
| 108 |
|
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| 109 | Inline void
|
---|
| 110 | dga_bit_and(VP addr, UW bitpat)
|
---|
| 111 | {
|
---|
| 112 | dga_write(addr, dga_read(addr) & bitpat);
|
---|
| 113 | }
|
---|
| 114 |
|
---|
| 115 | Inline void
|
---|
| 116 | dga_set_ilv(VP addr, UINT shift, UINT level)
|
---|
| 117 | {
|
---|
| 118 | dga_write(addr, (dga_read(addr) & ~(0x07 << shift))
|
---|
| 119 | | (level << shift));
|
---|
| 120 | }
|
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| 121 |
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| 122 | #endif /* _MACRO_ONLY */
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| 123 | #endif /* _DVE68K_DGA_H_ */
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