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Line 
1/*
2 * TOPPERS/JSP Kernel
3 * Toyohashi Open Platform for Embedded Real-Time Systems/
4 * Just Standard Profile Kernel
5 *
6 * Copyright (C) 2000-2003 by Embedded and Real-Time Systems Laboratory
7 * Toyohashi Univ. of Technology, JAPAN
8 * Copyright (C) 2007 by Embedded and Real-Time Systems Laboratory
9 * Graduate School of Information Science, Nagoya Univ., JAPAN
10 *
11 * 上記著作権者
12は,以下の (1)〜(4) の条件か,Free Software Foundation
13 * によってå…
14¬è¡¨ã•ã‚Œã¦ã„ã‚‹ GNU General Public License の Version 2 に記
15 * 述されている条件を満たす場合に限り,本ソフトウェア(本ソフトウェア
16 * を改変したものを含む.以下同じ)を使用・複製・改変・再é…
17å¸ƒï¼ˆä»¥ä¸‹ï¼Œ
18 * 利用と呼ぶ)することを無償で許諾する.
19 * (1) 本ソフトウェアをソースコードの形で利用する場合には,上記の著作
20 * 権表示,この利用条件および下記の無保証規定が,そのままの形でソー
21 * スコード中に含まれていること.
22 * (2) 本ソフトウェアを,ライブラリ形式など,他のソフトウェア開発に使
23 * 用できる形で再é…
24å¸ƒã™ã‚‹å ´åˆã«ã¯ï¼Œå†é…
25å¸ƒã«ä¼´ã†ãƒ‰ã‚­ãƒ¥ãƒ¡ãƒ³ãƒˆï¼ˆåˆ©ç”¨
26 * 者
27マニュアルなど)に,上記の著作権表示,この利用条件および下記
28 * の無保証規定を掲載すること.
29 * (3) 本ソフトウェアを,機器に組み込むなど,他のソフトウェア開発に使
30 * 用できない形で再é…
31å¸ƒã™ã‚‹å ´åˆã«ã¯ï¼Œæ¬¡ã®ã„ずれかの条件を満たすこ
32 * と.
33 * (a) 再é…
34å¸ƒã«ä¼´ã†ãƒ‰ã‚­ãƒ¥ãƒ¡ãƒ³ãƒˆï¼ˆåˆ©ç”¨è€…
35マニュアルなど)に,上記の著
36 * 作権表示,この利用条件および下記の無保証規定を掲載すること.
37 * (b) 再é…
38å¸ƒã®å½¢æ…
39‹ã‚’,別に定める方法によって,TOPPERSプロジェクトに
40 * 報告すること.
41 * (4) 本ソフトウェアの利用により直接的または間接的に生じるいかなる損
42 * 害からも,上記著作権者
43およびTOPPERSプロジェクトをå…
44è²¬ã™ã‚‹ã“と.
45 *
46 * 本ソフトウェアは,無保証で提供されているものである.上記著作権者
47お
48 * よびTOPPERSプロジェクトは,本ソフトウェアに関して,その適用可能性も
49 * 含めて,いかなる保証も行わない.また,本ソフトウェアの利用により直
50 * 接的または間接的に生じたいかなる損害に関しても,その責任を負わない.
51 *
52 * @(#) $Id: sys_support.S,v 1.2 2007/05/28 02:03:55 honda Exp $
53 */
54
55/*
56 * ターゲットシステム依存モジュール アセンブリ言語部(m3a_za36用)
57 */
58
59#define _MACRO_ONLY
60
61#include <m32rasm.inc>
62
63/*
64 * 使用するSFR定義
65 */
66#define BSEL0CR 0x00ef5000 /* BSEL0制御レジスタ */
67#define SDRF0 0x00ef6000 /* SDRAMリフレッシュ制御レジスタ0 */
68#define SDRF1 0x00ef6004 /* SDRAMリフレッシュ制御レジスタ1 */
69#define SDIR0 0x00ef6008 /* SDRAM初期化レジスタ0 */
70#define SDIR1 0x00ef600c /* SDRAM初期化レジスタ1 */
71#define SD0ADR 0x00ef6020 /* SDRAM0アドレスレジスタ */
72#define SD0ER 0x00ef6024 /* SDRAM0アクセスイネーブルレジスタ */
73#define SD0TR 0x00ef6028 /* SDRAM0タイミングレジスタ */
74#define SD0MOD 0x00ef602c /* SDRAM0モードレジスタ */
75#define SD1ADR 0x00ef6040 /* SDRAM1アドレスレジスタ */
76#define SD1ER 0x00ef6044 /* SDRAM1アクセスイネーブルレジスタ */
77#define SD1TR 0x00ef6048 /* SDRAM1タイミングレジスタ */
78#define SD1MOD 0x00ef604c /* SDRAM1モードレジスタ */
79#define MCCR 0xfffffffc /* キャッシュ制御レジスタ */
80#define ICUIMASK 0x00eff01c /* 割込みマスクレジスタ */
81
82/*
83 * SDRAM設定マクロ定義
84 */
85#define SDRF1_VAL 0x00010017 /* SDRAMリフレッシュ制御レジスタ1設定値 */
86#define SDIR0_VAL 0x00000001 /* SDRAM初期化レジスタ0設定値 */
87#define SD0ADR_VAL 0x04000004 /* SDRAM0アドレスレジスタ設定値 */
88#define SD0TR_VAL 0x00020102 /* SDRAM0タイミングレジスタ設定値 */
89#define SD0MOD_VAL 0x00000020 /* SDRAM0モードレジスタ設定値 */
90
91/*
92 * ブロックセレクトコントローラの設定値
93 */
94#define BSEL0CR_VAL 0x01011100
95
96/*
97 * ハードウェア初期化処理
98 *
99 * data,bssセクションをSDRAM領域にé…
100ç½®ã™ã‚‹å ´åˆã«ã¯ï¼Œãƒ‡ãƒãƒƒã‚¬å´ã§
101 * SDRAMを初期化する.その場合は,hardware_init_hookでは何もしない.
102 */
103#if 0
104Function hardware_init_hook
105
106 /*
107 * ブロックセレクトコントローラの設定
108 */
109 mLdadr r2, BSEL0CR_VAL
110 ld24 r3, #BSEL0CR
111 st r2, @r3
112
113 /*
114 * キャッシュモードの設定
115 */
116 ldi r0, #0x00 /* キャッシュOFF */
117 ldi r2, #MCCR /* 符号拡張させてアドレスをロード */
118 st r0, @r2 /* 命令/データキャッシュモード選択 */
119
120 /*
121 * 外部SDRAMの設定
122 */
123 /* --- SDRAM初期化 -- */
124 ld24 r2, #SDIR0 /* SDRAM初期化レジスタ0 */
125 mLdadr r3, SDIR0_VAL /* 初期化プリチャージ後ウエイト(DPC) 3BCLK */
126 /* 初期化オートリフレッシュ回数(DARFC) 8回 */
127 /* 初期化オートリフレッシュ要求間隔(DARFI) 8BCLK */
128 st r3, @r2 /* 設定 */
129
130 ld24 r2, #SDIR1 /* H'00EF600c */
131 ldi r3, #0x00000001 /* 初期化開始 */
132 st r3, @r2
133
134 /* --- SDRAM初期化シーケンス完了待
135ち -- */
136wait_sdram:
137 ldh r3, @r2
138 bnez r3, wait_sdram /* 初期化終了? */
139
140 /* -- SDRAMモードレジスタセットコマンド発行 */
141 ld24 r2, #SD0MOD /* SDRAM0モードレジスタ */
142 mLdadr r3, SD0MOD_VAL /* バーストモード */
143 /* CL=2 */
144 /* バーストタイプ:シーケンシャル */
145 /* バースト長 */
146 st r3, @r2 /* 設定 */
147
148 /* ---- SDRAMタイミングレジスタ設定 -- */
149 ld24 r2, #SD0TR /* SDRAMタイミングレジスタ */
150 mLdadr r3, SD0TR_VAL /* RASアクティブ期間(DRAS) 3BCLK */
151 /* RAS-CASレーテンシ(DRCD) 1BCLK */
152 /* RASプリチャージ(DPCG) 1BCLK */
153 /* ライトリカバリ時間(DWR) 2BCLK */
154 /* SDRAMコントローラCASレーテンシ(DCL) 2BCLK */
155 st r3, @r2 /* 設定 */
156
157 /* --- SDRAM領域設定(H'04000000から32Mバイト,32bitBUS) */
158 ld24 r2, #SD0ADR /* SDRAM0アドレスレジスタ */
159 mLdadr r3, SD0ADR_VAL /* å…
160ˆé ­ã‚¢ãƒ‰ãƒ¬ã‚¹(DADR) H'0400 xxxx */
161 /* データバス幅
162選択(DBSZ) 32ビット */
163 /* チャネルサイズ設定(DSZ) 64Mバイト */
164 st r3, @r2 /* 設定 */
165
166 /* ---- オートリフレッシュ有効、要求間隔:1344クロックに設定 */
167 ld24 r2, #SDRF1 /* SDRAMリフレッシュ制御レジスタ1 */
168 mLdadr r3, SDRF1_VAL /* オートリフレッシュ(DRFEN) 1(有効) */
169 /* オートリフレッシュウェイト(DREFW) 8BCLK */
170 /* オートリフレッシュ要求間隔(DRFC) 1344BCLK */
171 st r3, @r2
172
173 /* SDRAMアクセス有効 */
174 ld24 r2, #SD0ER /* SDRAMアクセスイネーブルレジスタ */
175 ldi r3, #0x01 /* 設定値をレジスタに格納 */
176 st r3, @r2
177 rts
178#endif
179
180Function software_init_hook
181 ld24 r0, ICUIMASK + 1
182 ldi r1, 7
183 stb r1, @r0 /* 割込みマスクをå…
184¨è¨±å¯ã«è¨­å®š */
185 rts
Note: See TracBrowser for help on using the repository browser.