1 | ;
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2 | ; TOPPERS/JSP Kernel
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3 | ; Toyohashi Open Platform for Embedded Real-Time Systems/
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4 | ; Just Standard Profile Kernel
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5 | ;
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6 | ; Copyright (C) 2000-2004 by Embedded and Real-Time Systems Laboratory
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7 | ; Toyohashi Univ. of Technology, JAPAN
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8 | ; Copyright (C) 2001-2007 by Industrial Technology Institute,
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9 | ; Miyagi Prefectural Government, JAPAN
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10 | ; Copyright (C) 2001-2004 by Dep. of Computer Science and Engineering
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11 | ; Tomakomai National College of Technology, JAPAN
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12 | ;
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13 | ; ä¸è¨è使¨©è
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14 | ã¯ï¼ä»¥ä¸ã® (1)ã(4) ã®æ¡ä»¶ãï¼Free Software Foundation
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16 | ¬è¡¨ããã¦ãã GNU General Public License ã® Version 2 ã«è¨
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59 |
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60 | .CPU 300HA
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61 | .SECTION P, CODE, ALIGN=2
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62 |
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63 | .INCLUDE "sys_config_asm.inc"
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64 | .INCLUDE "cpu_config_asm.inc"
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65 |
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68 | èµRAMãã¹ã¿ãã¯ã«ãã¦ã
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70 | ;
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71 | .GLOBAL _hardware_init_hook
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72 | _hardware_init_hook:
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73 |
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74 | .AIFDEF RAM
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75 | ;ããããã°æã«RAMä¸ã«ãã¦ã³ãã¼ãããå ´åã¯
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76 | ;ããã¹ã»ã¹ãã¼ãã»ã³ã³ããã¼ã©ã®è¨å®ãè¡ããªãã
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77 | .AELSE
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82 | ;ããããã¨ãªã¢ï¼ã«SRAMãæ¥ç¶
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83 | ;ãããããã»ã¢ãã¬ã¹ãã¹ï¼A0-A21
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84 | ;ãããããã»ãã¼ã¿ãã¹ï¼16ãããå¹
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85 |
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86 | ;ãããããã»ãã³ã¦ã§ã¼ã
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88 | ;ãããå
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91 |
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92 | ;ãenable A0-A7
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93 | ;ããP1DDRâ0xff
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94 | mov.b #H'ff, r1l
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95 | mov.l #H8P1DDR, er0
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96 | mov.b r1l, @er0
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97 |
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98 | ;ãenable A8-A15
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99 | ;ããP2DDRâ0xff
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100 | mov.b r1l, @((H8P2DDR-H8P1DDR), er0)
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101 |
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102 | ;ãenable A16-A19
|
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103 | ;ããP5DDR[3-0]â0xf
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104 | mov.b #H'0f, r1l
|
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105 | mov.b r1l, @((H8P5DDR-H8P1DDR), er0)
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106 |
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107 | ;ãA20ï¼ã¢ã¼ã6ã§ã¯å¸¸ã«enable
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108 |
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109 | ;ãenable A21
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110 | ;ããBRCR.A21Eâ0
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111 | mov.l #H8BRCR, er2
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112 | bclr #H8BRCR_A21E_BIT, @er2
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113 |
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114 | ;ãD15-D8ï¼ã¢ã¼ã6ã§ã¯ãã¼ã3ã常ã«ãã¼ã¿ãã¹ã«ãªã
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115 | ;ãD7 -D0ï¼16ããããã¹ã¢ã¼ãã«ããã¨ãã¼ã4ããã¼ã¿ãã¹ã«ãªã
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116 |
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117 | ;ãã¨ãªã¢ï¼ã16ãããã¢ã¯ã»ã¹ç©ºéã«è¨å®
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118 | ;ããABWCR.ABW1â0
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119 | ;ãããã®è¨å®ã§ãã¼ã4ããã¼ã¿ãã¹D7-D0ã«ãªã
|
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120 | mov.l #H8ABWCR, er2
|
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121 | bclr #H8ABWCR_ABW1_BIT, @er2
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122 |
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123 | ;ãã¨ãªã¢ï¼ã2ã¹ãã¼ãã¢ã¯ã»ã¹ã«è¨å®
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124 | ;ããASTCR.AST1â0
|
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125 | mov.l #H8ASTCR, er2
|
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126 | bclr #H8ASTCR_AST1_BIT, @er2
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127 |
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128 | ;ãenable CS1ï¼P83ãCS1ã«è¨å®ï¼
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129 | ;ããP8DDR.P83DDRâ1
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130 | ;ãããP8DDRã¯èªã¿åºãã¦ãå¤ãä¸å®ãªã®ã§ããããæ¼ç®ãè¡ããã
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131 | ;ãããåãªã䏿¸ãããã
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132 | mov.b #H8P8DDR_CS1, r1l
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133 | mov.b r1l, @((H8P8DDR-H8P1DDR), er0)
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134 |
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135 | .AENDI ; RAM
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136 |
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137 | rts
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138 |
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139 | .END
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